sr锁存器原理（sr锁存器的作用）

网友发稿 2023-10-16 13:34

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SR锁存器(Set-ResetLatch)是静态存储单元当中最基本，也是电路结构最简单的一种，通常由两个或非门或者与非门组成。

SR锁存器是锁存器中的最基本构件，分为与非门和或非门两种。

与非门SR锁存器（Set-ResetLatch）属于静态存储单元的一种，通常由两个或非门或者与非门组成，锁存器的特性是，当两个输入端都为高电平（为1）时，sr锁存器翻转，其他3种情况保持原状态。

基本RS触发器可以由两个与非门按正反馈方式闭合构成。通常将Q端的状态定义为锁存器的状态，即Q=1时，称为锁存器处于1的状态；Q=0时，称锁存器处于0的状态，电路具有两个稳态。

有这种锁存器的芯片如下：根据道客巴巴资料显示，74HC00系列是常用的数字逻辑门芯片，包含四个双输入NAND门，可以通过它们来构建SR锁存器。

译码器、加法器属于组合逻辑电路。寄存器、计数器属于时序逻辑电路。

简称组合电路，它由最基本的逻辑门电路组合而成。特点是：输出值只与当时的输入值有关，即输出惟一地由当时的输入值决定。

组合逻辑电路由门电路组成，其某一时刻的输出状态只与该时刻的输入状态有关，而与电路原来的状态无关，并没有记忆功能。

锁存器(Latch)是一种对脉冲电平敏感的存储单元电路，它们可以在特定输入脉冲电平作用下改变状态。简单锁存器定义：只有在有锁存信号时输入的状态被保存到输出，直到下一个锁存信号。通常只有0和1两个值。

存储电路是一种能够存储信息并在需要时进行读取的电路，它通常使用存储元件（如触发器或锁存器）来实现。存储电路具有记忆功能，能够存储输入信号的值，并在需要时输出。与时序电路类似，存储电路也不符合组合逻辑电路的定义。

s、r的值是当前的输入值，q也是的输入值，当知道s、r、q三个端口的值，便可对照真值表知道下个时刻的q的值，即q*的值就是表示下个时刻的q值。

S=1，R=1：触发器维持原来状态不变。S=0，R=0：此时无法确定触发器的状态。一般这是不允许的，因此触发器的输入端S、R不能同时为0。

只要S 为0时Q一定输出为1，只要 R为0时Q一定输出1，（由内部逻辑图决定的），Q和Q只有在正常情况下才是一个为1一个为0，当S ，R都为0两个输出就都是1，这是种不正常工作状态，应该避免出现这种情况。

SR锁存器的功能保持，置位0，置位1。高电平1有效触发，对1敏感。

输出端 Q 和 Q* 是相反的逻辑关系（非关系），如果 R、S一定，那么输出就一定了，即，Q 和 Q* 都不会变化。

同一个SR出现不同的Q值可能有两种情况：该锁存器有异步清零端。当异步清零端有效时不论SR是什么电平，输出Q都是‘0’。锁存器工作中出现S和R同时有效后的情况了（这种工作状态是不允许的）。

1、锁存器（Latch）是一种对脉冲电平敏感的存储单元电路，它们可以在特定输入脉冲电平作用下改变状态。锁存，就是把信号暂存以维持某种电平状态。

2、锁存器(latch)---对脉冲电平敏感，在时钟脉冲的电平作用下改变状态锁存器是电平触发的存储单元，数据存储的动作取决于输入时钟(或者使能)信号的电平值，仅当锁存器处于使能状态时，输出才会随着数据输入发生变化。

3、同理，当松开按键时， S端出现的接触抖动亦不会影响输出的状态。

4、在电子和自动化控制中，分为模拟信号和数字信号，在数字逻辑电子电路中，数字信号是二进制的，即只有0信号和1信号。

5、此时规定的高电平电压会低一点，最低会有7V左右。高电平、低电平是相对的。

6、如果再次检测到低电平之后说明键被按下。这个过程就是所说的消除抖动。3 显示部分如图5说明：对于显示部分，因为这个系统只是显示转速，所以采用了LED共阳极数码管。并且用了74HC573锁存器，74HC573锁存器输出电流大，接口电路简单。

首先按下启动按钮SB，通过KM、KA2常闭接点使KA1吸合，KA1常开接点闭合通过KA2常闭接点使接触器KM吸合，KM常开主触点吸合，电机启动，通过KM常开接点吸合进行接触器KM自保持通电，电机持续运转，此时SB按钮处于断开状态。

——★控制电路也很简单，是互锁电路，其原理就自己分析吧。

这是一个绕线式电动机转子串电阻启动的控制原理图。

这是一个线性稳压电源。设3DA3DG6 Vbe=0.7V 首先通过变压器将AC220转成AC24V，然后通过桥堆和电容C1进行整流滤波；3DA1为调整管，3DG6是调整管。

这是个可以发送到调频收音机的无线话筒。前级音频接收放大电路由驻极体话筒BM、偏置电阻R1和耦合电容C1等组成，其功能是拾取声音转换为电信号并进行音频放大。

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